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目录1

第1章 逻辑代数1

第2章 逻辑门电路的构成及其工作原理41

第3章 组合逻辑电路及逻辑设计47

第4章 计算机中十进制整数的加减法运算原理55

第5章 集成式双稳态触发器69

第6章 时序逻辑电路概述93

第7章 一阶钟控式时序电路101

第8章 数模转换器与模数转换器177

第9章 一阶钟控式时序电路补充183

9.1 分频器及其逻辑设计183

9.1.1 分频器的定义、分类及一般组成框图183

9.1.2 分频数p可变的p/q型分频器的设计流程图185

9.1.3 分频数p可变的p/q型分频器设计举例186

9.1.4 非等时态钟控式时序电路及其组成框图188

9.2 矩形脉冲信号划分器及其逻辑设计189

9.2.1 矩形脉冲信号划分器的定义、分类及组成框图189

9.2.2 矩形脉冲信号划分器设计的流程图192

9.2.3 矩形脉冲信号划分器设计举例192

9.2.4 步进器及其组成框图196

第10章 二阶与高阶钟控式时序电路199

10.1 二阶与高阶钟控式存储网络的逻辑设计199

10.1.1 二阶钟控式存储网络的状态转移表199

10.1.2 几种常用的二阶钟控式存储网络的状态转移表202

10.1.3 高阶钟控式存储网络的状态转移表204

10.1.4 几种常用的高阶钟控式存储网络的状态转移表205

10.1.5 高阶钟控式存储网络环形状态转移路径的生成208

10.1.6 二阶钟控式存储网络设计举例：开环式左移位寄存器211

10.1.7 高阶钟控式存储网络设计举例：数码寄存器214

10.2 开环式移位寄存器及最大状态转移环的求解方法218

10.2.1 开环式左移位寄存器218

10.2.2 K位二进制数开环式移位变换的最大状态转移环的求解方法220

10.3 闭环式非线性左移位寄存器225

10.3.1 概述225

10.3.2 闭环式左移位寄存器的组成框图与分类225

10.3.3 闭环式非线性左移位寄存器的逻辑设计226

10.4 闭环式线性左移位寄存器229

10.4.1 闭环式线性左移位寄存器的分析229

10.4.2 闭环式线性左移位寄存器的设计235

10.5 移位寄存器型的串行信号序列发生器235

10.5.1 移位寄存器型串行信号序列发生器的组成框图235

10.5.2 L位二进制数的左移位划分236

10.5.3 移位寄存器型串行信号序列发生器的设计步骤240

10.5.4 移位寄存器型串行信号序列发生器的设计举例1240

10.5.5 移位寄存器型串行信号序列发生器的设计举例2242

10.6 递推式串行信号序列检测器244

10.6.1 串行信号序列检测器概述244

10.6.2 递推式串行信号序列检测器的功能及状态转移-输出功能图245

10.6.3 递推式单一种串行信号序列检测器设计举例247

10.6.4 几点说明251

10.7 变进制码制计数器及其逻辑设计251

10.7.1 变进制码制计数器的组成框图及其状态转移-进位功能表251

10.7.2 变进制码制计数器设计举例253

10.7.3 可逆计数器逻辑设计举例258

10.7.4 几点说明264

参考文献265