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第1章 引言1

1.1数字复接概念1

1.2数字复接等级2

1.3 CCITT建议3

1.4本书结构5

第2章 同步复接6

2.1同步复接设备组成6

2.2帧结构8

2.3帧定位问题9

2.4同步搜捕方法10

2.5帧定位信号码型11

2.6平均搜捕时间13

2.7帧定位信号最佳长度16

2.8同步状态保护19

2.9搜捕过程校核22

2.10帧定位保护参数25

2.11平均失帧时间和平均同步时间27

2.12同步失帧误码28

2.13帧定位搜捕/保持逻辑29

2.14同步环境保障33

2.15 CCITT建议35

第3章 正码速调整37

3.1准同步复接（Plesiochronous Multiplex）37

3.2正码速调整原理38

3.3正码速调整基本关系式39

3.4码速调整设计41

3.5码速调整过渡过程43

3.6稳定调整过程读写时差变动范围46

3.7码速调整过渡过程分类49

3.8码速恢复设计50

3.9锁相环参数设计52

3.10压控振荡器设计57

3.11缓冲存储器容量59

3.12 CCITT建议60

第4章 正码速调整损伤63

4.1塞入抖动63

4.2塞入误码81

第5章正/负码速调整88

5.1正/负码速调整原理88

5.2硬判决控制码速调整89

5.3自适应控制码速调整92

5.4正/负调整控制电路99

5.5码速调整过渡过程101

5.6码速调整参数设计103

5.7码速调整环境设计105

5.8正/负调整技术应用108

5.9正/负调整设计举例109

5.10码速调整性能比较115

5.11 CCITT建议116

第6章正/0/负码速调整117

6.1正/0/负码速调整概念117

6.2增量控制正/0/负码速调整原理117

6.3数字平滑正/0/负码速调整原理118

6.4帧结构120

6.5调整及恢复控制123

6.6码速调整过渡过程126

6.7数字平滑131

6.8西德PCM30D脉冲平滑原理132

6.9澳大利亚2/8Mbit/s复接器脉冲平滑原理134

6.10正/0/负码速调整工程应用136

第7章 码速调整测量技术137

7.1塞入抖动测量137

7.2复接误码测量147

7.3码速恢复锁相环特性测量154

第8章 帧调整原理157

8.1概述157

8.2帧调整分类159

8.3前置缓冲帧调整器工作原理160

8.4 2048kbit/s帧调整器设计163

8.5帧调整器的附加功能169

第9章 高次群同步数字复接体系170

9.1问题的提出170

9.2高次群同步数字体系170

9.3同步/异步数字体系接口总体安排173

9.4 C-4进入STM-1安排设计176

9.5 C-3进入STM-1安排设计178

9.6 TUG进入高阶VC安排设计182

9.7基本包装进入TUG184

9.8 STM-N复接188

9.9 CCITT建议负荷包装接口190

9.10负荷包装接口改善设计195

第10章 抗衰落帧同步203

10.1抗衰落帧同步原理203

10.2帧同步平均持续时间206

10.3帧失步平均持续时间226

10.4帧同步方案比较239

第11章 工程应用设计249

11.1通用准同步群复接设计249

11.2标准/非标准速率兼容设计259

11.3准同步/同步复接兼容设计264

11.4 2/34Mbit/s复接设计269

11.5群干线传输中的分支设计279

11.6网间互通复接设计288

11.7子群复接设计294

11.8 ISDN用户/网络接口复接设技304

11.9复接系统维护设计315

再版结语324

参考文献325

全集出版后记331